Re: broken ftdi_sio communication on MIPSEL router, various 2.6.3x.x kernels (usbmon logs etc.)

[Andreas Mohr <andi@xxxxxxxx>]

On Sun, Dec 06, 2009 at 04:00:16PM -0500, Alan Stern wrote:
> You're grasping at straws.  But if you want to indulge yourself, just 
> about every USB drive uses bulk and not interrupt endpoints.  Some may 
> _have_ interrupt endpoints, because they are provided by the chip 
> manufacturer, but they don't _use_ them.
> 
> For a more productive debugging experience, get a usbmon trace of the
> failure, and afterwards see what's present in the debugging files in
> the appropriate subdirectory of /sys/kernel/debug/usb/ohci.

Well, yes, those were "initial" attempts.

Now I've been doing quite a bit more analysis of the driver, found a couple
issues and endianness bugs (irrelevant on my device though),
have (rather too) many ideas for changes.

I'm currently leaning towards chip lockup (causing USB malfunction,
as evidenced by lsusb descriptor timeouts) somehow triggered by
serial handshake setup problems. That would mean that the chip has
its USB/serial operation not fully isolated, thus an overrun due to
handshake issues (when communicating with the custom-made PIC on the
user side of things) would be able to kill the USB side of the equation.
An interesting detail in this regard is that one was actually able to
read back some bytes, when first loading the driver and _then_ plugging,
thus we ended up with a fresh device without any buffers filled
(although ftdi_sio does submit reset requests to the chip on startup,
so I don't quite see why that might be a problem...).

NOTE that my device has DTR/DSR wired!! (and RTS/CTS is unsoldered!).
And the DTR/DSR setup in the driver is quite quirky (somewhat
understandable given that Linux even lacks DTR/DSR configuration on the
software side):
One, ftdi_sio keeps sending redundant handshake _configuration_ (a possible
source of chip confusion / USB bus contention, which might be a problem
given internet reports of FTDI lockup in case of concurrent
communication) instead of caching the current settings on the driver side,
two, it doesn't assert DTR, thus possibly confusing the chip management
(or user-device PIC!) about availability of the DTE.

Given this information I now have some quite frugal next debug attempts
to make, fortunately.
(plus maybe even cleanly separating the hookup to alternatively try
an RTS/CTS setup for further insights)


Following are port-specific usbmon logs (isolated from a 0u log),
just for reference
(I'm not really sure whether it's useful to go through them now,
given that on my side I should first triage handshake setup some more,
and the setup on netbook/router was too asymmetric).
For device-specific requests shown below (bytes 40 0x), see ftdi_sio.h
(FTDI_SIO_RESET etc.).
NOTE that timing on the router log is _much_ more aggressive, most certainly
due to not plugging directly into a HC port with OHCI full-speed
config, but via transaction translation on a high-speed-configured
HC port on the router (crap, another asymmetric "feature" of the usbmon
logs below, sorry).

Thanks,

Andreas Mohr

=== Log on netbook (WORKING) ===:

eab4eb80 765761798 S Ci:2:016:0 s 80 06 0100 0000 0012 18 <
eab4eb80 765767830 C Ci:2:016:0 0 18 = 12011001 00000008 0304e8e0 00020102 0301
eab4eb80 765767874 S Ci:2:016:0 s 80 06 0200 0000 0009 9 <
eab4eb80 765772827 C Ci:2:016:0 0 9 = 09022000 010100a0 16
eab4eb80 765772869 S Ci:2:016:0 s 80 06 0200 0000 0020 32 <
eab4eb80 765779828 C Ci:2:016:0 0 32 = 09022000 010100a0 16090400 0002ffff ff020705 81024000 00070502 02400000
eab4eb80 765779873 S Ci:2:016:0 s 80 06 0300 0000 00ff 255 <
eab4eb80 765782828 C Ci:2:016:0 0 4 = 04030904
eab4eb80 765782864 S Ci:2:016:0 s 80 06 0302 0409 00ff 255 <
eab4eb80 765791812 C Ci:2:016:0 0 32 = 20034500 4c005600 20004600 48005a00 20003100 33003000 30002000 50004300
eab4eb80 765791852 S Ci:2:016:0 s 80 06 0301 0409 00ff 255 <
eab4eb80 765795827 C Ci:2:016:0 0 14 = 0e034500 4c005600 20004100 4700
eab4eb80 765795873 S Ci:2:016:0 s 80 06 0303 0409 00ff 255 <
eab4eb80 765802827 C Ci:2:016:0 0 18 = 12034500 4c003500 4d003300 36003200 3900
eab4eb80 765803379 S Co:2:016:0 s 00 09 0001 0000 0000 0
eab4eb80 765804824 C Co:2:016:0 0 0
eab4eb80 765805018 S Ci:2:016:0 s 80 06 0302 0409 00ff 255 <
eab4eb80 765808868 C Ci:2:016:0 0 32 = 20034500 4c005600 20004600 48005a00 20003100 33003000 30002000 50004300
f61b3880 766072515 S Ci:2:016:0 s c0 0a 0000 0000 0001 1 <
f61b3880 766073823 C Ci:2:016:0 -32 0
ea837b00 767354427 S Co:2:016:0 s 40 09 0001 0000 0000 0
ea837b00 767355825 C Co:2:016:0 -32 0
ea837b00 767355891 S Co:2:016:0 s 40 00 0000 0000 0000 0
ea837b00 767356825 C Co:2:016:0 0 0
ea837b00 767356866 S Co:2:016:0 s 40 04 0008 0000 0000 0
ea837b00 767357824 C Co:2:016:0 0 0
ea837b00 767357870 S Co:2:016:0 s 40 03 4138 0000 0000 0
ea837b00 767358824 C Co:2:016:0 0 0
ea837b00 767358866 S Co:2:016:0 s 40 02 0000 0000 0000 0
ea837b00 767359825 C Co:2:016:0 0 0
f61b3d80 767359863 S Bi:2:016:1 -115 512 <
f61b3d80 767371823 C Bi:2:016:1 0 2 = 3160
f61b3d80 767371835 S Bi:2:016:1 -115 512 <
f61b3d80 767387838 C Bi:2:016:1 0 2 = 3160
f61b3d80 767387849 S Bi:2:016:1 -115 512 <
f626d300 767396218 S Co:2:016:0 s 40 04 0008 0000 0000 0
f626d300 767396832 C Co:2:016:0 0 0
f626d300 767396938 S Co:2:016:0 s 40 03 4138 0000 0000 0
f626d300 767397835 C Co:2:016:0 0 0
f626d300 767397950 S Co:2:016:0 s 40 02 0000 0000 0000 0
f626d300 767398834 C Co:2:016:0 0 0
f61b3d80 767403838 C Bi:2:016:1 0 2 = 3160
f61b3d80 767403856 S Bi:2:016:1 -115 512 <
d0dca280 767408121 S Co:2:016:0 s 40 04 0008 0000 0000 0
d0dca280 767408836 C Co:2:016:0 0 0
d0dca280 767408959 S Co:2:016:0 s 40 03 4138 0000 0000 0
d0dca280 767409837 C Co:2:016:0 0 0
d0dca280 767409962 S Co:2:016:0 s 40 02 0000 0000 0000 0
d0dca280 767410820 C Co:2:016:0 0 0
d0dca280 767411505 S Co:2:016:0 s 40 04 0008 0000 0000 0
d0dca280 767411817 C Co:2:016:0 0 0
d0dca280 767411882 S Co:2:016:0 s 40 03 4138 0000 0000 0
d0dca280 767412833 C Co:2:016:0 0 0
d0dca280 767413087 S Co:2:016:0 s 40 02 0000 0000 0000 0
d0dca280 767413818 C Co:2:016:0 0 0
d0dca280 767414065 S Co:2:016:0 s 40 04 0008 0000 0000 0
d0dca280 767414818 C Co:2:016:0 0 0
d0dca280 767414921 S Co:2:016:0 s 40 03 4138 0000 0000 0
d0dca280 767415817 C Co:2:016:0 0 0
d0dca280 767416024 S Co:2:016:0 s 40 02 0000 0000 0000 0
d0dca280 767416820 C Co:2:016:0 0 0
d0dca280 767417070 S Co:2:016:0 s 40 04 0008 0000 0000 0
d0dca280 767417819 C Co:2:016:0 0 0
d0dca280 767417855 S Co:2:016:0 s 40 03 4138 0000 0000 0
d0dca280 767418820 C Co:2:016:0 0 0
d0dca280 767418856 S Co:2:016:0 s 40 02 0000 0000 0000 0
d0dca280 767419819 C Co:2:016:0 0 0
f61b3d80 767419838 C Bi:2:016:1 0 2 = 3160
f61b3d80 767419845 S Bi:2:016:1 -115 512 <
d0dca280 767420096 S Co:2:016:0 s 40 04 0008 0000 0000 0
d0dca280 767420818 C Co:2:016:0 0 0
d0dca280 767420851 S Co:2:016:0 s 40 03 4138 0000 0000 0
d0dca280 767421817 C Co:2:016:0 0 0
d0dca280 767421845 S Co:2:016:0 s 40 02 0000 0000 0000 0
d0dca280 767422819 C Co:2:016:0 0 0
d0dca280 767423058 S Co:2:016:0 s 40 04 0008 0000 0000 0
d0dca280 767423819 C Co:2:016:0 0 0
d0dca280 767423856 S Co:2:016:0 s 40 03 4138 0000 0000 0
d0dca280 767424819 C Co:2:016:0 0 0
d0dca280 767424854 S Co:2:016:0 s 40 02 0000 0000 0000 0
d0dca280 767425819 C Co:2:016:0 0 0
d0dca280 767426431 S Bo:2:016:2 -115 8 = 8106c982 02011f60
d0dca280 767426816 C Bo:2:016:2 0 8 >
f61b3d80 767435823 C Bi:2:016:1 0 2 = 0160
f61b3d80 767435840 S Bi:2:016:1 -115 512 <
f61b3d80 767436823 C Bi:2:016:1 0 2 = 3160
f61b3d80 767436839 S Bi:2:016:1 -115 512 <
f61b3d80 767451820 C Bi:2:016:1 0 16 = 3160810c c9af0102 1f04a007 1c324054
f61b3d80 767451836 S Bi:2:016:1 -115 512 <
f61b3d80 767467825 C Bi:2:016:1 0 2 = 3160
f61b3d80 767467843 S Bi:2:016:1 -115 512 <
f61b3d80 767483823 C Bi:2:016:1 0 2 = 3160
f61b3d80 767483839 S Bi:2:016:1 -115 512 <
f61b3d80 767499823 C Bi:2:016:1 0 2 = 3160
f61b3d80 767499840 S Bi:2:016:1 -115 512 <
f61b3d80 767515825 C Bi:2:016:1 0 2 = 3160
f61b3d80 767515841 S Bi:2:016:1 -115 512 <
f61b3d80 767531820 C Bi:2:016:1 0 2 = 3160
f61b3d80 767531831 S Bi:2:016:1 -115 512 <
f61b3d80 767547823 C Bi:2:016:1 0 2 = 3160
f61b3d80 767547840 S Bi:2:016:1 -115 512 <
f61b3d80 767563823 C Bi:2:016:1 0 2 = 3160
f61b3d80 767563838 S Bi:2:016:1 -115 512 <
f61b3d80 767579825 C Bi:2:016:1 0 2 = 3160
f61b3d80 767579842 S Bi:2:016:1 -115 512 <
f61b3d80 767595824 C Bi:2:016:1 0 2 = 3160
f61b3d80 767595841 S Bi:2:016:1 -115 512 <
f61b3d80 767611820 C Bi:2:016:1 0 2 = 3160
f61b3d80 767611831 S Bi:2:016:1 -115 512 <
f61b3d80 767627836 C Bi:2:016:1 0 2 = 3160
f61b3d80 767627851 S Bi:2:016:1 -115 512 <
f61b3d80 767643835 C Bi:2:016:1 0 2 = 3160
f61b3d80 767643852 S Bi:2:016:1 -115 512 <
f61b3d80 767659839 C Bi:2:016:1 0 2 = 3160
f61b3d80 767659855 S Bi:2:016:1 -115 512 <
f61b3d80 767675837 C Bi:2:016:1 0 2 = 3160
f61b3d80 767675853 S Bi:2:016:1 -115 512 <
d0dca900 767678355 S Co:2:016:0 s 40 04 0008 0000 0000 0
d0dca900 767678828 C Co:2:016:0 0 0
d0dca900 767678872 S Co:2:016:0 s 40 03 4138 0000 0000 0
d0dca900 767679836 C Co:2:016:0 0 0
d0dca900 767679883 S Co:2:016:0 s 40 02 0000 0000 0000 0
d0dca900 767680833 C Co:2:016:0 0 0
d0dca900 767681712 S Bo:2:016:2 -115 10 = 810804af c9018457 0208
d0dca900 767682833 C Bo:2:016:2 0 10 >
f61b3d80 767691829 C Bi:2:016:1 0 2 = 3160
f61b3d80 767691842 S Bi:2:016:1 -115 512 <
f61b3d80 767692835 C Bi:2:016:1 0 2 = 0160
f61b3d80 767692851 S Bi:2:016:1 -115 512 <
f61b3d80 767693837 C Bi:2:016:1 0 2 = 3160
f61b3d80 767693854 S Bi:2:016:1 -115 512 <
f61b3d80 767708838 C Bi:2:016:1 0 12 = 3160810f c9be0102 84010807
f61b3d80 767708859 S Bi:2:016:1 -115 512 <
f61b3d80 767724838 C Bi:2:016:1 0 9 = 31604013 6e6f5494 0f
f61b3d80 767724858 S Bi:2:016:1 -115 512 <
f61b3d80 767740840 C Bi:2:016:1 0 2 = 3160
f61b3d80 767740858 S Bi:2:016:1 -115 512 <
f61b3d80 767756836 C Bi:2:016:1 0 2 = 3160
f61b3d80 767756854 S Bi:2:016:1 -115 512 <
f61b3d80 767772836 C Bi:2:016:1 0 2 = 3160
f61b3d80 767772854 S Bi:2:016:1 -115 512 <
f61b3d80 767788837 C Bi:2:016:1 0 2 = 3160
f61b3d80 767788853 S Bi:2:016:1 -115 512 <
f61b3d80 767804837 C Bi:2:016:1 0 2 = 3160
f61b3d80 767804850 S Bi:2:016:1 -115 512 <
f61b3d80 767820839 C Bi:2:016:1 0 2 = 3160
f61b3d80 767820857 S Bi:2:016:1 -115 512 <
f61b3d80 767836839 C Bi:2:016:1 0 2 = 3160
f61b3d80 767836854 S Bi:2:016:1 -115 512 <
f61b3d80 767852837 C Bi:2:016:1 0 2 = 3160
f61b3d80 767852851 S Bi:2:016:1 -115 512 <
f61b3d80 767868824 C Bi:2:016:1 0 2 = 3160
f61b3d80 767868843 S Bi:2:016:1 -115 512 <
f61b3d80 767884835 C Bi:2:016:1 0 2 = 3160
f61b3d80 767884850 S Bi:2:016:1 -115 512 <
f61b3d80 767900839 C Bi:2:016:1 0 2 = 3160
f61b3d80 767900856 S Bi:2:016:1 -115 512 <
f61b3d80 767916838 C Bi:2:016:1 0 2 = 3160
f61b3d80 767916854 S Bi:2:016:1 -115 512 <
f61b3d80 767932823 C Bi:2:016:1 0 2 = 3160
f61b3d80 767932843 S Bi:2:016:1 -115 512 <
f6761b80 767932934 S Bo:2:016:2 -115 7 = 81050450 c90186
f6761b80 767933832 C Bo:2:016:2 0 7 >
f61b3d80 767940838 C Bi:2:016:1 0 2 = 0160
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f61b3d80 790786851 S Bi:2:016:1 -115 512 <
f61b3d80 790802839 C Bi:2:016:1 0 2 = 3160
f61b3d80 790802849 S Bi:2:016:1 -115 512 <
f61b3d80 790818839 C Bi:2:016:1 0 2 = 3160
f61b3d80 790818849 S Bi:2:016:1 -115 512 <
f61b3d80 790834824 C Bi:2:016:1 0 2 = 3160
f61b3d80 790834839 S Bi:2:016:1 -115 512 <
f61b3d80 790850818 C Bi:2:016:1 0 2 = 3160
f61b3d80 790850834 S Bi:2:016:1 -115 512 <
f61b3d80 790866836 C Bi:2:016:1 0 2 = 3160
f61b3d80 790866849 S Bi:2:016:1 -115 512 <
f61b3d80 790882836 C Bi:2:016:1 0 2 = 3160
f61b3d80 790882846 S Bi:2:016:1 -115 512 <
f61b3d80 790898845 C Bi:2:016:1 0 2 = 3160
f61b3d80 790898862 S Bi:2:016:1 -115 512 <
f61b3d80 790914838 C Bi:2:016:1 0 2 = 3160
f61b3d80 790914848 S Bi:2:016:1 -115 512 <
f61b3d80 790930834 C Bi:2:016:1 0 2 = 3160
f61b3d80 790930844 S Bi:2:016:1 -115 512 <
f61b3d80 790946839 C Bi:2:016:1 0 2 = 3160
f61b3d80 790946851 S Bi:2:016:1 -115 512 <
f61b3d80 790962835 C Bi:2:016:1 0 2 = 3160
f61b3d80 790962846 S Bi:2:016:1 -115 512 <
f61b3d80 790978838 C Bi:2:016:1 0 2 = 3160
f61b3d80 790978851 S Bi:2:016:1 -115 512 <
f61b3d80 790994838 C Bi:2:016:1 0 2 = 3160
f61b3d80 790994849 S Bi:2:016:1 -115 512 <
f61b3d80 791010840 C Bi:2:016:1 0 2 = 3160
f61b3d80 791010852 S Bi:2:016:1 -115 512 <
f61b3d80 791026845 C Bi:2:016:1 0 2 = 3160
f61b3d80 791026858 S Bi:2:016:1 -115 512 <
f61b3d80 791042839 C Bi:2:016:1 0 2 = 3160
f61b3d80 791042850 S Bi:2:016:1 -115 512 <
f61b3d80 791058835 C Bi:2:016:1 0 2 = 3160
f61b3d80 791058845 S Bi:2:016:1 -115 512 <
f61b3d80 791074844 C Bi:2:016:1 0 2 = 3160
f61b3d80 791074856 S Bi:2:016:1 -115 512 <
f61b3d80 791090837 C Bi:2:016:1 0 2 = 3160
f61b3d80 791090848 S Bi:2:016:1 -115 512 <
f61b3d80 791106839 C Bi:2:016:1 0 2 = 3160
f61b3d80 791106849 S Bi:2:016:1 -115 512 <
f61b3d80 791122841 C Bi:2:016:1 0 2 = 3160
f61b3d80 791122855 S Bi:2:016:1 -115 512 <
f61b3d80 791138841 C Bi:2:016:1 0 2 = 3160
f61b3d80 791138855 S Bi:2:016:1 -115 512 <
f61b3d80 791154844 C Bi:2:016:1 0 2 = 3160
f61b3d80 791154859 S Bi:2:016:1 -115 512 <
f61b3d80 791170848 C Bi:2:016:1 0 2 = 3160
f61b3d80 791170866 S Bi:2:016:1 -115 512 <
f61b3d80 791186831 C Bi:2:016:1 0 2 = 3160
f61b3d80 791186843 S Bi:2:016:1 -115 512 <
f61b3d80 791202841 C Bi:2:016:1 0 2 = 3160
f61b3d80 791202853 S Bi:2:016:1 -115 512 <
f61b3d80 791218835 C Bi:2:016:1 0 2 = 3160
f61b3d80 791218846 S Bi:2:016:1 -115 512 <
f61b3d80 791234838 C Bi:2:016:1 0 2 = 3160
f61b3d80 791234848 S Bi:2:016:1 -115 512 <
f61b3d80 791250840 C Bi:2:016:1 0 2 = 3160
f61b3d80 791250851 S Bi:2:016:1 -115 512 <
f61b3d80 791266841 C Bi:2:016:1 0 2 = 3160
f61b3d80 791266852 S Bi:2:016:1 -115 512 <
f61b3d80 791282838 C Bi:2:016:1 0 2 = 3160
f61b3d80 791282849 S Bi:2:016:1 -115 512 <
f61b3d80 791298834 C Bi:2:016:1 0 2 = 3160
f61b3d80 791298844 S Bi:2:016:1 -115 512 <
f61b3d80 791314841 C Bi:2:016:1 0 2 = 3160
f61b3d80 791314852 S Bi:2:016:1 -115 512 <
f61b3d80 791330835 C Bi:2:016:1 0 2 = 3160
f61b3d80 791330845 S Bi:2:016:1 -115 512 <
f61b3d80 791346838 C Bi:2:016:1 0 2 = 3160
f61b3d80 791346849 S Bi:2:016:1 -115 512 <
f61b3d80 791362841 C Bi:2:016:1 0 2 = 3160
f61b3d80 791362856 S Bi:2:016:1 -115 512 <
f61b3d80 791378840 C Bi:2:016:1 0 2 = 3160
f61b3d80 791378854 S Bi:2:016:1 -115 512 <
f61b3d80 791394846 C Bi:2:016:1 0 2 = 3160
f61b3d80 791394861 S Bi:2:016:1 -115 512 <
f61b3d80 791410847 C Bi:2:016:1 0 2 = 3160
f61b3d80 791410862 S Bi:2:016:1 -115 512 <
f61b3d80 791426840 C Bi:2:016:1 0 2 = 3160
f61b3d80 791426852 S Bi:2:016:1 -115 512 <
f61b3d80 791442842 C Bi:2:016:1 0 2 = 3160
f61b3d80 791442856 S Bi:2:016:1 -115 512 <
f61b3d80 791458839 C Bi:2:016:1 0 2 = 3160
f61b3d80 791458854 S Bi:2:016:1 -115 512 <
f61b3d80 791474843 C Bi:2:016:1 0 2 = 3160
f61b3d80 791474858 S Bi:2:016:1 -115 512 <
f61b3d80 791490839 C Bi:2:016:1 0 2 = 3160
f61b3d80 791490851 S Bi:2:016:1 -115 512 <
f61b3d80 791506837 C Bi:2:016:1 0 2 = 3160
f61b3d80 791506848 S Bi:2:016:1 -115 512 <
f61b3d80 791522842 C Bi:2:016:1 0 2 = 3160
f61b3d80 791522856 S Bi:2:016:1 -115 512 <
f61b3d80 791538844 C Bi:2:016:1 0 2 = 3160
f61b3d80 791538859 S Bi:2:016:1 -115 512 <
f61b3d80 791554843 C Bi:2:016:1 0 2 = 3160
f61b3d80 791554858 S Bi:2:016:1 -115 512 <
f61b3d80 791570841 C Bi:2:016:1 0 2 = 3160
f61b3d80 791570860 S Bi:2:016:1 -115 512 <
f61b3d80 791586835 C Bi:2:016:1 0 2 = 3160
f61b3d80 791586847 S Bi:2:016:1 -115 512 <
f61b3d80 791602837 C Bi:2:016:1 0 2 = 3160
f61b3d80 791602848 S Bi:2:016:1 -115 512 <
f61b3d80 791618843 C Bi:2:016:1 0 2 = 3160
f61b3d80 791618854 S Bi:2:016:1 -115 512 <
f61b3d80 791634839 C Bi:2:016:1 0 2 = 3160
f61b3d80 791634850 S Bi:2:016:1 -115 512 <
f61b3d80 791650835 C Bi:2:016:1 0 2 = 3160
f61b3d80 791650845 S Bi:2:016:1 -115 512 <
f61b3d80 791666837 C Bi:2:016:1 0 2 = 3160
f61b3d80 791666848 S Bi:2:016:1 -115 512 <
f61b3d80 791682841 C Bi:2:016:1 0 2 = 3160
f61b3d80 791682852 S Bi:2:016:1 -115 512 <
f61b3d80 791698831 C Bi:2:016:1 0 2 = 3160
f61b3d80 791698849 S Bi:2:016:1 -115 512 <
f61b3d80 791714827 C Bi:2:016:1 0 2 = 3160
f61b3d80 791714843 S Bi:2:016:1 -115 512 <
f61b3d80 791730826 C Bi:2:016:1 0 2 = 3160
f61b3d80 791730843 S Bi:2:016:1 -115 512 <
f61b3d80 791746829 C Bi:2:016:1 0 2 = 3160
f61b3d80 791746844 S Bi:2:016:1 -115 512 <
f61b3d80 791762830 C Bi:2:016:1 0 2 = 3160
f61b3d80 791762848 S Bi:2:016:1 -115 512 <
f61b3d80 791778826 C Bi:2:016:1 0 2 = 3160
f61b3d80 791778843 S Bi:2:016:1 -115 512 <
f61b3d80 791794824 C Bi:2:016:1 0 2 = 3160
f61b3d80 791794838 S Bi:2:016:1 -115 512 <
f61b3d80 791810826 C Bi:2:016:1 0 2 = 3160
f61b3d80 791810844 S Bi:2:016:1 -115 512 <
f61b3d80 791826827 C Bi:2:016:1 0 2 = 3160
f61b3d80 791826845 S Bi:2:016:1 -115 512 <
f61b3d80 791842848 C Bi:2:016:1 0 2 = 3160
f61b3d80 791842864 S Bi:2:016:1 -115 512 <
f61b3d80 791858847 C Bi:2:016:1 0 2 = 3160
f61b3d80 791858866 S Bi:2:016:1 -115 512 <
f61b3d80 791874843 C Bi:2:016:1 0 2 = 3160
f61b3d80 791874857 S Bi:2:016:1 -115 512 <
f61b3d80 791890834 C Bi:2:016:1 0 2 = 3160
f61b3d80 791890845 S Bi:2:016:1 -115 512 <
f61b3d80 791906842 C Bi:2:016:1 0 2 = 3160
f61b3d80 791906856 S Bi:2:016:1 -115 512 <
f61b3d80 791922839 C Bi:2:016:1 0 2 = 3160
f61b3d80 791922853 S Bi:2:016:1 -115 512 <
f61b3d80 791938856 C Bi:2:016:1 0 2 = 3160
f61b3d80 791938879 S Bi:2:016:1 -115 512 <
f61b3d80 791954842 C Bi:2:016:1 0 2 = 3160
f61b3d80 791954857 S Bi:2:016:1 -115 512 <
f61b3d80 791970837 C Bi:2:016:1 0 2 = 3160
f61b3d80 791970851 S Bi:2:016:1 -115 512 <
f61b3d80 791986840 C Bi:2:016:1 0 2 = 3160
f61b3d80 791986851 S Bi:2:016:1 -115 512 <
f61b3d80 792002847 C Bi:2:016:1 0 2 = 3160
f61b3d80 792002864 S Bi:2:016:1 -115 512 <
f61b3d80 792018842 C Bi:2:016:1 0 2 = 3160
f61b3d80 792018856 S Bi:2:016:1 -115 512 <
f61b3d80 792034842 C Bi:2:016:1 0 2 = 3160
f61b3d80 792034860 S Bi:2:016:1 -115 512 <
f61b3d80 792050844 C Bi:2:016:1 0 2 = 3160
f61b3d80 792050860 S Bi:2:016:1 -115 512 <
f61b3d80 792066842 C Bi:2:016:1 0 2 = 3160
f61b3d80 792066857 S Bi:2:016:1 -115 512 <
f61b3d80 792082834 C Bi:2:016:1 0 2 = 3160
f61b3d80 792082845 S Bi:2:016:1 -115 512 <
f61b3d80 792098841 C Bi:2:016:1 0 2 = 3160
f61b3d80 792098852 S Bi:2:016:1 -115 512 <
f61b3d80 792114837 C Bi:2:016:1 0 2 = 3160
f61b3d80 792114848 S Bi:2:016:1 -115 512 <
f61b3d80 792130840 C Bi:2:016:1 0 2 = 3160
f61b3d80 792130852 S Bi:2:016:1 -115 512 <
f61b3d80 792146840 C Bi:2:016:1 0 2 = 3160
f61b3d80 792146850 S Bi:2:016:1 -115 512 <
f61b3d80 792162842 C Bi:2:016:1 0 2 = 3160
f61b3d80 792162854 S Bi:2:016:1 -115 512 <
f61b3d80 792178838 C Bi:2:016:1 0 2 = 3160
f61b3d80 792178848 S Bi:2:016:1 -115 512 <
f61b3d80 792194840 C Bi:2:016:1 0 2 = 3160
f61b3d80 792194850 S Bi:2:016:1 -115 512 <
f61b3d80 792210838 C Bi:2:016:1 0 2 = 3160
f61b3d80 792210848 S Bi:2:016:1 -115 512 <
f61b3d80 792226846 C Bi:2:016:1 0 2 = 3160
f61b3d80 792226862 S Bi:2:016:1 -115 512 <
e277ce80 792240019 S Co:2:016:0 s 40 04 0008 0000 0000 0
e277ce80 792240842 C Co:2:016:0 0 0
e277ce80 792241071 S Co:2:016:0 s 40 03 4138 0000 0000 0
e277ce80 792241832 C Co:2:016:0 0 0
e277ce80 792242039 S Co:2:016:0 s 40 02 0000 0000 0000 0
e277ce80 792242833 C Co:2:016:0 0 0
f61b3d80 792242850 C Bi:2:016:1 0 2 = 3160
f61b3d80 792242858 S Bi:2:016:1 -115 512 <
f61b3d80 792243837 C Bi:2:016:1 -2 0
e277ce80 792244056 S Co:2:016:0 s 40 02 0000 0000 0000 0
e277ce80 792244838 C Co:2:016:0 0 0
e277ce80 792245101 S Co:2:016:0 s 40 01 0300 0000 0000 0
e277ce80 792245834 C Co:2:016:0 0 0


=== Log on Router ===:
(note that this build has the c0 0a / c0 09 device-specific requests
removed, since the get/set latency requests aren't available on older
chips, thus they barf)
[yes, unfortunately that means that the logs are asymmetric, but that's
the ones I currently have]

81e90a80 2602408083 S Ci:2:005:0 s 80 06 0100 0000 0012 18 <
81e90a80 2602408674 C Ci:2:005:0 0 18 = 12011001 00000008 0304e8e0 00020102 0301
81e90f00 2602409309 S Ci:2:005:0 s 80 06 0200 0000 0009 9 <
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